Влияние развязывающих конденсаторов на качество электропитания и целостность сигнала
Введение
Разработчикам оборудования крайне важно знать резонансную частоту каждого элемента (например, блокировочного/развязывающего конденсатора, планарного конденсатора и индуктивности межсоединения) цепи питания на печатной плате и ее влияние на качество электропитания. Низкое качество электропитания печатной платы, например, из-за более высокого, чем планировалось, импеданса цепи питания в широком диапазоне частот приводит к одновременному появлению шума коммутации (SSN) и сужению глазковой диаграммы сигнала, передаваемого интегральной схемой, которая подключена к этой цепи питания.
В статье рассматривается совместное моделирование качества электропитания и целостности сигнала в разработанной топологии с помощью ПО Mentor HyperLynx с целью анализа влияния развязывающих конденсаторов на импеданс цепи питания, SSN и глазковые диаграммы.
Анализ и результаты
Исследовалась печатная плата, содержащая систему-на-кристалле (СнК) с интерфейсом памяти DDR4. На рис. 1а показана цепь питания на 1,2 В, расположенная на слое 4, которая подает напряжение на интерфейс памяти с одной ИС (выводы выделены синим цветом). При этом цепь заземления, или опорная земля, выделенная зеленым цветом, располагается на слое 5. ИС памяти имеет 13 выводов питания BGA. Места, занимаемые развязывающими конденсаторами емкостью 0,22 мкФ (выделены коричневым цветом) в корпусе типа 0201, находятся между выводами каждого контакта питания и заземления. Кроме того, между цепью 1,2 В и заземлением включены шунтирующие конденсаторы с емкостями 10 и 1 мкФ (выделены коричневым цветом). Восемь информационных сигналов этого интерфейса показаны на рис. 1б.
Для изучения влияния развязывающих конденсаторов на импеданс цепи питания, SSN и глазковые диаграммы было выполнено совместное моделирование качества электропитания и целостности сигнала с помощью ПО HyperLynx для нескольких перечисленных в таблице конфигураций цепи питания. У них – одинаковые топологии печатной платы и слои (рис. 1a–б), нагруженные одним шунтирующим конденсатором 10 мкФ и одним шунтирующим конденсатором 1 мкФ.
Конфигурация цепи питания |
Шунтирующий/развязывающий конденсатор |
Кол-во конденсаторов |
A |
10 мкФ |
1 |
1 мкФ |
1 |
|
0,22 мкФ |
0 |
|
Б |
10 мкФ |
1 |
1 мкФ |
1 |
|
0,22 мкФ |
4 |
|
В |
10 мкФ |
1 |
1 мкФ |
1 |
|
0,22 мкФ |
8 |
|
Г |
10 мкФ |
1 |
1 мкФ |
1 |
|
0,22 мкФ |
13 |
В конфигурации А конденсаторы 0,22 мкФ отсутствуют. В конфигурации Б имеются четыре конденсатора 0,22 мкФ. В конфигурации В количество конденсаторов 0,22 мкФ увеличено до восьми. В конфигурации Г количество конденсаторов 0,22 мкФ стало еще больше – 13.
Затем в программный инструмент были импортированы модели питания ИС памяти и системы-на-кристалле в формате IBIS v5.0. Операция чтения памяти со скоростью 1 Гбит/с и частотой Найквиста 500 МГц установлена для режима совместного моделирования, в котором шиной данных управляет ИС памяти, а СнК служит приемником (Rx).
Сначала было проведено сравнение импедансов цепи питания в диапазоне 1000 Гц…2 ГГц для четырех конфигураций цепи питания. В теории резонансная частота обратно пропорциональна емкости. Как видно из рис. 2, у всех четырех конфигураций цепи питания – одинаковый профиль импеданса в диапазоне 1000 Гц…10 МГц из-за размещения одинакового количества шунтирующих конденсаторов емкостью 10 и 1 мкФ. Конфигурация А (без развязывающих конденсаторов 0,22 мкФ) отличается от конфигураций Б, В и Г (в каждой из них имеется не менее четырех развязывающих конденсаторов 0,22 мкФ). Заметим, что импеданс цепи питания уменьшился как минимум на 0,9 Ом на частотах выше 10 МГц.
Далее были построены графики зависимости SSN от времени для всех конфигураций цепи питания (рис. 3). SSN возникает в результате прохождения через полное сопротивление цепи питания переходного тока в буфере (Tx) интегральной схемы при передаче сигнала. Переходной ток возрастает при увеличении числа буферов Tx в интегральной схеме, которые одновременно переключаются для передачи информационного сигнала. Из рис. 3 видно, что в конфигурации Б амплитуда SSN (III) в два раза больше амплитуды (II) из-за большего переходного тока в ИС, поскольку переключается больше буферов Tx.
С другой стороны, при одновременном переключении восьми буферов Tx на скорости 1 Гбит/с наибольшая амплитуда SSN наблюдается у цепи питания в конфигурации A с наименьшей развязкой и наибольшим импедансом (в диапазоне сотен МГц): 505 мВ (пик–пик), как видно из рис. 3а. Напротив, цепь питания в конфигурации Г с наилучшей развязкой (13 конденсаторов 0,22 мкФ) и наименьшим импедансом демонстрирует наименьшую амплитуду SSN – 95 мВ (пик–пик) (рис. 3д), что соответствует допуску ±5% для источника питания 1,2 В, указанному в таблице технических характеристик ИС памяти.
Наконец, глазковые диаграммы информационных сигналов DDR4 со скоростью 1 Гбит/с и последовательностью битов PRBS‑7 (наблюдаемой при Rx или в СнК) сравнивались для конфигураций А и Г (рис. 4a и 4б, соответственно). Гораздо большая высота и ширина глазка для информационных сигналов данных в конфигурации Г указывает на то, что подавление SSN за счет лучшего качества электропитания помогает уменьшить джиттер в сигналах, передаваемых интегральной схемой памяти. Закрытие глазка в конфигурации А указывает на увеличение риска битовых ошибок и неустойчивости приема. Подавление SSN достигается путем правильного размещения достаточного количества развязывающих конденсаторов на шине питания относительно земли.
Выводы
Описанное совместное моделирование качества электропитания и целостности сигнала в разработанной топологии показало, что правильное размещение достаточного количества развязывающих конденсаторов в цепи питания относительно земли положительно влияет на импеданс цепи питания, SSN и глазковые диаграммы. Кроме того, необходимо провести предварительное моделирование целостности сигнала в требуемых сигнальных линиях, чтобы обеспечить оптимальную схему терминирования и минимальные потери в линии передачи перед совместным моделированием для анализа взаимного влияния качества электропитания и целостности сигнала.
- B. Olney. Power Distribution Network Planning. The PCB Magazine. May. 2012.
- F. Carrio, V. Gonzalez, and E. Sanchis. Basic Concepts of Power Distribution Network Design for High-Speed Transmission. The Open Optics Journal. 5. (Suppl. 1–M8). 2011.
- E. Bogatin, Signal and Power Integrity – Simplified: 2nd Edition. Prentice Hall. 2009.
- Mentor HyperLynx. Power-Aware Signal Integrity Analysis.
- Micron. Power Integrity Simulation with IBIS 5.0 Models Technical Note.